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TPS54340 DCDC芯片问题

Other Parts Discussed in Thread: TPS54340

作者的疑问为:

                         请问这个TPS54340芯片稳定性怎么样和LM2576比较。

                         现在TPS54340的EN不是很清楚怎么使用,尤其是公式中那几个参数

                         pin6是否可以不接?

                         Pin4的也不大清楚,

                         电压基准电阻公式中出现的是RHS和RLS请问都对应哪个电阻?

帖子的链接为:http://www.deyisupport.com/question_answer/analog/power_management/f/24/t/45943.aspx

解答问题的TI FAE为: 

TPS54340 是一款 42V,3.5A,降压稳压器,此稳压器具有一个集成的高侧 MOSFET。 按照 ISO 7637 标准,此器件能够耐受高达 45V 的抛负载脉冲。 电流模式控制提供了简单的外部补偿和灵活的组件选择。 一个低纹波脉冲跳跃模式将无负载时的电源电流减小至 146μA。 当启用引脚被拉至低电平时,关断电源电流被减少至 1μA。
欠压闭锁在内部设定为 4.3V,但可用使能引脚将之提高。 输出电压启动斜升由内部控制以提供一个受控的启动并且消除过冲。
宽开关频率范围可实现对效率或者外部组件尺寸的优化。 频率折返和热关断在过载条件下保护内部和外部组件。

芯片的外围简化电路如下:

效率与负载电流间的关系

芯片的引脚及引脚功能如下:

1、自举电容器需要BOOT和SW之间。如果在此电容器的电压来操作高侧MOSFET所需的最小值以下时,输出被关断,直到电容器被刷新

2、输入电源电压为4.5 V至42 V的工作范围

3、使能端,与内部上拉电流源。低于1.2 V拉禁用。浮来启用。调整输入欠压锁定两个电阻

4、定时电阻和外部时钟。使用外部电阻器接地,以设置开关频率时的内部放大器持有该终端在一个固定的电压。如果该终端在上述PLL的上限阈值拉动时,一个模式发生变化,并在终端成为同步输入。内部放大器被禁用,并且该终端是一个高阻抗时钟输入到内部的PLL。如果时钟边缘停下时,重新启用内部放大器和操作模式返回到电阻器的频率程序。

5、反向跨导(GM)误差放大器的输入端

6、误差放大器的输出和输入到输出开关电流(PWM)比较器。连接频率补偿组件,该终端。

7、地

8、内部高侧功率MOSFET的源和转换器的交换节点

对于散热焊盘,GND端子必须电连接到在印刷电路板的露出焊盘正确操作。

绝对最大额定值表格如下

功能框图

对于作者的疑问,TI FAE的解答为:EN脚内部有上拉电流源,因此悬空和接高于1.3V电压都可以令其正常工作,接低于1.1V(包括接GND), 芯片shut down.

频率补偿小信号模型如下图:

该TPS54340采用跨导放大器的误差放大器和支持三个commonly-的
使用频率补偿电路。补偿电路类型2A,2B型,1型2型电路通常实施的高带宽电源设计采用低ESR
输出电容器。类型1电路使用高ESR铝电解或电源设计
钽电容器。等式13和等式14涉及的放大器的频率响应于所述小
的开环增益和带宽的信号模型所使用的RO和CO中所示模拟

基于电路的参数TI FAE对作者进行的加大如下: